一种基于FPGA的反馈式级联板卡同步处理方法

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专利状态

一种基于FPGA的反馈式级联板卡同步处理方法

有效

专利申请进度

申请

2020-06-15

申请公布

2020-09-22

授权

2023-08-29

预估到期

2040-06-15

专利基础信息

申请号	CN202010540678.4	申请日	2020-06-15
申请公布号	CN111694790A	申请公布日	2020-09-22
授权公布号	CN111694790B	授权公告日	2023-08-29
分类号	G06F15/78
分类	计算；推算；计数;
申请人名称	浪潮集团有限公司
申请人地址	山东省济南市高新区浪潮路1036号

专利法律状态

2023-08-29

授权

状态信息

授权
2020-10-20

实质审查的生效

状态信息

实质审查的生效；IPC(主分类):G06F15/78；申请日:20200615
2020-09-22

公布

状态信息

公布

摘要

本发明提供一种基于FPGA的反馈式级联板卡同步处理方法，属于FPGA应用技术领域，本发明包括用于同步信号生成和延迟计算的主控板卡，以及多个AD/DA板卡；多个AD/DA板卡并行连接到主控板卡，接收主卡下发的同步信号和同步延迟数据；主控板卡用于产生同步信号，不计算到不同板卡间的同步延时。本方法可实现多板卡的高精度同步处理，方法简单、通用性高。

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